组合逻辑路径存在分支时会使得路径的延时（）。

对于存在多管堆叠结构的大扇入逻辑门，应该把关键输入信号（最晚到达的信号）连接到（）。

A.内侧的晶体管上
B.外侧的晶体管上
C.尺寸最大的晶体管上

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一条组合逻辑路径，调整各级门的尺寸系数使得路径延时最短时对应的条件是（）。

A.所有逻辑门的尺寸系数取最小值
B.所有逻辑门的尺寸系数取面积允许的最大值
C.每级门的门努力都相等
D.门级门的逻辑努力都相等

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