‏verilogHDL中已经预先定义了的门级原型的符号有（）。

‍在verilogHDL的数字表达方式用，和十进制数127表示的数字相同的表达方式有（）。

A.8’b11_11_11_11
B.8’b1111111
C.8’h7f
D.8’d127

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‎verilog语法中，间隔符号主要包括（）。

A.换页符
B.换行符
C.TAB键
D.空格符

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