多项选择题

下列全加器中的进位输出逻辑表达式正确的是（），其中A，B，C分别是两个加数和进位输入（注：符号^表示异或运算）。

A.AB+C（A+B）
B.AB+C（A^B）
C.A+B+C
D.A^B^C

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热门试题

多项选择题

A.增加时钟线与其它互连线的间距
B.增加时钟线的宽度
C.时钟驱动器旁边放置去耦电容
D.在时钟线两侧放置地线
E.时钟线绕线时进行RC匹配

单项选择题

A.通过增加互连线的分支降低布线难度
B.通过均衡时钟信号的路径延时使得时钟偏差最小化
C.把时钟信号均匀的分散到芯片各处
D.使得每个分支上的时钟驱动器数量相等