单项选择题

下列关于状态机说法错误的是（）。

A.moore机的输出只与当前状态有关。
B.mealy机的输出与当前状态和输入都有关。
C.在Verilog代码中，求次态和输出，必须用case语句。
D.体现在verilog代码中就是，moore机的最后输出逻辑只判断当前状态，mealy机的输出逻辑中判断当前状态和输入。

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热门试题

单项选择题

根据以下代码always@（posedge clk）begin if （!rst_n）q<=a；判断rst_n信号：（）。

A.同步，高电平有效
B.同步，低电平有效
C.异步，低电平有效
D.异步，高电平有效

单项选择题

下列Moore型状态机采用Verilog语言主控时序部分正确的是（）。

A.always@（posedge clk or negedge reset）begin if（!reset）current_state<=s0；else current_state<=next_state；end
B.always@（posedge clk ）begin if（!reset）current_state<=s0；else current_state<=next_state；end
C.always@（posedge clk t）if（reset）current_state<=s0；else current_state<=next_state
D.always@（posedge clk or negedge reset）if（reset）current_state<=s0；else current_state<=next_state