已知原始状态图如下图所示，状态化简后电路需要的触发器应为（）个。

‏已知脉冲异步时序逻辑电路如下图所示，其功能是（）。

A.异步模8加1计数器
B.异步模8减1计数器
C.异步模6加1计数器
D.异步模6减1计数器

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‌已知某异步时序电路的流程表如下表所示，其中x1和x2为电路输入端。分析流程表，电路中有（）条反馈回路，当（）时会发生临界竞争。

A.1；电路处在稳定总态（00，11），输入由00→01时
B.2；电路处在稳定总态（00，11），输入由00→01时
C.2；电路处在稳定总态（11，01），输入由11→10时
D.2；电路处在稳定总态（11，11），输入由11→01时

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