多项选择题

由74161构成的时序电路如图所示，试问该电路中74161的输出端QD相对于时钟输入CLK是几分频？QD输出信号的占空比是多少？（）

A.QD相对于时钟输入CLK是10分频
B.QD输出信号的占空比是50%或1/2
C.QD输出信号的占空比是25%或1/4
D.QD相对于时钟输入CLK是8分频

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多项选择题
自选器件设计一个串入串出电路，要求该电路的输出信号F比输入信号X延迟3个CLK时钟周期。正确的电路有（）。

A.
B.
C.
D.
多项选择题
由74160构成的分频电路如图所示，CLK输入信号频率为10KHz，X为控制信号。分析该电路在X=0和X=1时的计数模值M和输出频率f分别为（）。

A.X=1，M=20，f=500Hz
B.X=0，M=100，f=100Hz
C.X=1，M=50，f=200Hz
D.X=0，M=10，f=1000Hz
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